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Quartus II Version 8.0 Build 231 07/10/2008 Service Pack 1 SJ Full Version
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; Table of Contents ;
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1. Legal Notice
2. Fitter Summary
3. Fitter Settings
4. Fitter Partition Preservation Settings
5. Pin-Out File
6. Fitter Resource Usage Summary
7. Input Pins
8. Output Pins
9. I/O Bank Usage
10. All Package Pins
11. Output Pin Default Load For Reported TCO
12. Fitter Resource Utilization by Entity
13. Delay Chain Summary
14. Pad To Core Delay Chain Fanout
15. Control Signals
16. Global & Other Fast Signals
17. Non-Global High Fan-Out Signals
18. Interconnect Usage Summary
19. LAB Logic Elements
20. LAB-wide Signals
21. LAB Signals Sourced
22. LAB Signals Sourced Out
23. LAB Distinct Inputs
24. Fitter Device Options
25. Fitter Messages
26. Fitter Suppressed Messages
----------------
; Legal Notice ;
----------------
Copyright (C) 1991-2008 Altera Corporation
Your use of Altera Corporation's design tools, logic functions
and other software and tools, and its AMPP partner logic
functions, and any output files from any of the foregoing
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Subscription Agreement, Altera MegaCore Function License
Agreement, or other applicable license agreement, including,
without limitation, that your use is for the sole purpose of
programming logic devices manufactured by Altera and sold by
Altera or its authorized distributors. Please refer to the
applicable agreement for further details.
+-----------------------------------------------------------------------+
; Fitter Summary ;
+-----------------------+-----------------------------------------------+
; Fitter Status ; Successful - Fri Jan 20 12:47:41 2012 ;
; Quartus II Version ; 8.0 Build 231 07/10/2008 SP 1 SJ Full Version ;
; Revision Name ; top_level ;
; Top-level Entity Name ; top_level ;
; Family ; Cyclone ;
; Device ; EP1C20F400C7 ;
; Timing Models ; Final ;
; Total logic elements ; 161 / 20,060 ( < 1 % ) ;
; Total pins ; 84 / 301 ( 28 % ) ;
; Total virtual pins ; 0 ;
; Total memory bits ; 0 / 294,912 ( 0 % ) ;
; Total PLLs ; 0 / 2 ( 0 % ) ;
+-----------------------+-----------------------------------------------+
+--------------------------------------------------------------------------------------------------------------------------------------+
; Fitter Settings ;
+--------------------------------------------------------------------+--------------------------------+--------------------------------+
; Option ; Setting ; Default Value ;
+--------------------------------------------------------------------+--------------------------------+--------------------------------+
; Device ; EP1C20F400C7 ; ;
; Fit Attempts to Skip ; 0 ; 0.0 ;
; Use smart compilation ; Off ; Off ;
; Maximum processors allowed for parallel compilation ; 1 ; 1 ;
; Use TimeQuest Timing Analyzer ; Off ; Off ;
; Router Timing Optimization Level ; Normal ; Normal ;
; Placement Effort Multiplier ; 1.0 ; 1.0 ;
; Router Effort Multiplier ; 1.0 ; 1.0 ;
; Optimize Hold Timing ; IO Paths and Minimum TPD Paths ; IO Paths and Minimum TPD Paths ;
; Optimize Fast-Corner Timing ; Off ; Off ;
; Optimize Timing ; Normal compilation ; Normal compilation ;
; Optimize IOC Register Placement for Timing ; On ; On ;
; Limit to One Fitting Attempt ; Off ; Off ;
; Final Placement Optimizations ; Automatically ; Automatically ;
; Fitter Aggressive Routability Optimizations ; Automatically ; Automatically ;
; Fitter Initial Placement Seed ; 1 ; 1 ;
; Slow Slew Rate ; Off ; Off ;
; PCI I/O ; Off ; Off ;
; Weak Pull-Up Resistor ; Off ; Off ;
; Enable Bus-Hold Circuitry ; Off ; Off ;
; Auto Global Memory Control Signals ; Off ; Off ;
; Auto Packed Registers ; Auto ; Auto ;
; Auto Delay Chains ; On ; On ;
; Auto Merge PLLs ; On ; On ;
; Perform Physical Synthesis for Combinational Logic for Performance ; Off ; Off ;
; Perform Register Duplication for Performance ; Off ; Off ;
; Perform Register Retiming for Performance ; Off ; Off ;
; Perform Asynchronous Signal Pipelining ; Off ; Off ;
; Fitter Effort ; Auto Fit ; Auto Fit ;
; Physical Synthesis Effort Level ; Normal ; Normal ;
; Logic Cell Insertion - Logic Duplication ; Auto ; Auto ;
; Auto Register Duplication ; Auto ; Auto ;
; Auto Global Clock ; On ; On ;
; Auto Global Register Control Signals ; On ; On ;
; Stop After Congestion Map Generation ; Off ; Off ;
; Save Intermediate Fitting Results ; Off ; Off ;
+--------------------------------------------------------------------+--------------------------------+--------------------------------+
+--------------------------------------------------------------------------------------------------------+
; Fitter Partition Preservation Settings ;
+------+-------------------+---------+------------------------------+------------------------+-----------+
; Name ; # Preserved Nodes ; # Nodes ; Preservation Level Requested ; Netlist Type Used ; Hierarchy ;
+------+-------------------+---------+------------------------------+------------------------+-----------+
; Top ; 0 ; 256 ; Placement and Routing ; Post-Synthesis Netlist ; ;
+------+-------------------+---------+------------------------------+------------------------+-----------+
+--------------+
; Pin-Out File ;
+--------------+
The pin-out file can be found in C:/Documents and Settings/hqtf51/Desktop/multiplier_block/multiplier_block/top_level.pin.
+----------------------------------------------------------------------+
; Fitter Resource Usage Summary ;
+---------------------------------------------+------------------------+
; Resource ; Usage ;
+---------------------------------------------+------------------------+
; Total logic elements ; 161 / 20,060 ( < 1 % ) ;
; -- Combinational with no register ; 119 ;
; -- Register only ; 0 ;
; -- Combinational with a register ; 42 ;
; ; ;
; Logic element usage by number of LUT inputs ; ;
; -- 4 input functions ; 91 ;
; -- 3 input functions ; 43 ;
; -- 2 input functions ; 25 ;
; -- 1 input functions ; 2 ;
; -- 0 input functions ; 0 ;
; ; ;
; Logic elements by mode ; ;
; -- normal mode ; 161 ;
; -- arithmetic mode ; 0 ;
; -- qfbk mode ; 5 ;
; -- register cascade mode ; 0 ;
; -- synchronous clear/load mode ; 2 ;
; -- asynchronous clear/load mode ; 3 ;
; ; ;
; Total registers ; 42 / 20,951 ( < 1 % ) ;
; Total LABs ; 20 / 2,006 ( < 1 % ) ;
; Logic elements in carry chains ; 0 ;
; User inserted logic elements ; 0 ;
; Virtual pins ; 0 ;
; I/O pins ; 84 / 301 ( 28 % ) ;
; -- Clock pins ; 1 / 2 ( 50 % ) ;
; Global signals ; 8 ;
; M4Ks ; 0 / 64 ( 0 % ) ;
; Total memory bits ; 0 / 294,912 ( 0 % ) ;
; Total RAM block bits ; 0 / 294,912 ( 0 % ) ;
; PLLs ; 0 / 2 ( 0 % ) ;
; Global clocks ; 8 / 8 ( 100 % ) ;
; JTAGs ; 0 / 1 ( 0 % ) ;
; Average interconnect usage (total/H/V) ; 0% / 0% / 0% ;
; Peak interconnect usage (total/H/V) ; 5% / 5% / 5% ;
; Maximum fan-out node ; inst3[3]~367 ;
; Maximum fan-out ; 20 ;
; Highest non-global fan-out signal ; inst3[3]~367 ;
; Highest non-global fan-out ; 20 ;
; Total fan-out ; 652 ;
; Average fan-out ; 2.64 ;
+---------------------------------------------+------------------------+
+--------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Input Pins ;
+--------------------+-------+----------+--------------+--------------+-------------+-----------------------+--------------------+--------+----------------+---------------+-----------------+----------+--------------+--------------+-------------+----------------------+
; Name ; Pin # ; I/O Bank ; X coordinate ; Y coordinate ; Cell number ; Combinational Fan-Out ; Registered Fan-Out ; Global ; Input Register ; Power Up High ; PCI I/O Enabled ; Bus Hold ; Weak Pull Up ; I/O Standard ; Termination ; Location assigned by ;
+--------------------+-------+----------+--------------+--------------+-------------+-----------------------+--------------------+--------+----------------+---------------+-----------------+----------+--------------+--------------+-------------+----------------------+
; clock ; K6 ; 1 ; 0 ; 17 ; 0 ; 11 ; 0 ; yes ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; Off ; Fitter ;
; instruction[0] ; F20 ; 3 ; 69 ; 27 ; 0 ; 0 ; 0 ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; Off ; Fitter ;
; instruction[1] ; F17 ; 3 ; 69 ; 30 ; 2 ; 0 ; 0 ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; Off ; Fitter ;
; instruction[2] ; J14 ; 3 ; 69 ; 21 ; 2 ; 0 ; 0 ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; Off ; Fitter ;
; instruction[3] ; N17 ; 3 ; 69 ; 10 ; 1 ; 0 ; 0 ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; Off ; Fitter ;
; instruction[4] ; R1 ; 1 ; 0 ; 6 ; 2 ; 0 ; 0 ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; Off ; Fitter ;
; instruction[5] ; N18 ; 3 ; 69 ; 10 ; 2 ; 0 ; 0 ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; Off ; Fitter ;
; instruction[6] ; F4 ; 1 ; 0 ; 28 ; 0 ; 0 ; 0 ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; Off ; Fitter ;
; instruction[7] ; W5 ; 4 ; 8 ; 0 ; 0 ; 0 ; 0 ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; Off ; Fitter ;
; instruction[8] ; N19 ; 3 ; 69 ; 10 ; 0 ; 0 ; 0 ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; Off ; Fitter ;
; reg_select_overide ; E11 ; 2 ; 38 ; 33 ; 2 ; 1 ; 0 ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; Off ; Fitter ;
+--------------------+-------+----------+--------------+--------------+-------------+-----------------------+--------------------+--------+----------------+---------------+-----------------+----------+--------------+--------------+-------------+----------------------+
+----------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Output Pins ;
+-------------------------------+-------+----------+--------------+--------------+-------------+-----------------+------------------------+---------------+----------------+-----------------+------------+---------------+----------+--------------+--------------+------------------+-------------+----------------------+-------+
; Name ; Pin # ; I/O Bank ; X coordinate ; Y coordinate ; Cell number ; Output Register ; Output Enable Register ; Power Up High ; Slow Slew Rate ; PCI I/O Enabled ; Open Drain ; TRI Primitive ; Bus Hold ; Weak Pull Up ; I/O Standard ; Current Strength ; Termination ; Location assigned by ; Load ;
+-------------------------------+-------+----------+--------------+--------------+-------------+-----------------+------------------------+---------------+----------------+-----------------+------------+---------------+----------+--------------+--------------+------------------+-------------+----------------------+-------+
; a_alu_load ; B8 ; 2 ; 22 ; 33 ; 1 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; Fitter ; 10 pF ;
; a_enable ; H6 ; 1 ; 0 ; 21 ; 0 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; Fitter ; 10 pF ;
; a_load ; K19 ; 3 ; 69 ; 19 ; 2 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; Fitter ; 10 pF ;
; a_select ; D12 ; 2 ; 38 ; 33 ; 0 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; Fitter ; 10 pF ;
; address[0] ; J17 ; 3 ; 69 ; 20 ; 0 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; Fitter ; 10 pF ;
; address[1] ; C9 ; 2 ; 28 ; 33 ; 0 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; Fitter ; 10 pF ;
; address[2] ; J7 ; 1 ; 0 ; 20 ; 2 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; Fitter ; 10 pF ;
; alu_a[0] ; E9 ; 2 ; 30 ; 33 ; 1 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; Fitter ; 10 pF ;
; alu_a[1] ; J1 ; 1 ; 0 ; 22 ; 0 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; Fitter ; 10 pF ;
; alu_a[2] ; A10 ; 2 ; 32 ; 33 ; 1 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; Fitter ; 10 pF ;
; alu_a[3] ; J6 ; 1 ; 0 ; 20 ; 1 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; Fitter ; 10 pF ;
; alu_r0[0] ; C10 ; 2 ; 34 ; 33 ; 2 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; Fitter ; 10 pF ;
; alu_r0[1] ; B11 ; 2 ; 36 ; 33 ; 1 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; Fitter ; 10 pF ;
; alu_r0[2] ; E10 ; 2 ; 30 ; 33 ; 0 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; Fitter ; 10 pF ;
; alu_r0[3] ; R7 ; 4 ; 16 ; 0 ; 1 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; Fitter ; 10 pF ;
; alu_r1[0] ; U10 ; 4 ; 32 ; 0 ; 1 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; Fitter ; 10 pF ;
; alu_r1[1] ; Y8 ; 4 ; 24 ; 0 ; 0 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; Fitter ; 10 pF ;
; alu_r1[2] ; Y10 ; 4 ; 34 ; 0 ; 1 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; Fitter ; 10 pF ;
; alu_r1[3] ; F10 ; 2 ; 32 ; 33 ; 0 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; Fitter ; 10 pF ;
; data[0] ; M17 ; 3 ; 69 ; 12 ; 1 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; Fitter ; 10 pF ;
; data[1] ; H20 ; 3 ; 69 ; 23 ; 1 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; Fitter ; 10 pF ;
; data[2] ; G5 ; 1 ; 0 ; 27 ; 2 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; Fitter ; 10 pF ;
; data[3] ; J16 ; 3 ; 69 ; 22 ; 0 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; Fitter ; 10 pF ;
; data_bus[0] ; W9 ; 4 ; 30 ; 0 ; 0 ; no ; no ; no ; no ; no ; no ; yes ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; Fitter ; 10 pF ;
; data_bus[1] ; T10 ; 4 ; 32 ; 0 ; 2 ; no ; no ; no ; no ; no ; no ; yes ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; Fitter ; 10 pF ;
; data_bus[2] ; Y9 ; 4 ; 30 ; 0 ; 1 ; no ; no ; no ; no ; no ; no ; yes ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; Fitter ; 10 pF ;
; data_bus[3] ; V10 ; 4 ; 32 ; 0 ; 0 ; no ; no ; no ; no ; no ; no ; yes ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; Fitter ; 10 pF ;
; data_mem_enable ; J5 ; 1 ; 0 ; 20 ; 0 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; Fitter ; 10 pF ;
; data_mem_load ; J2 ; 1 ; 0 ; 22 ; 1 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; Fitter ; 10 pF ;
; instruction_address[0] ; V9 ; 4 ; 26 ; 0 ; 0 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; Fitter ; 10 pF ;
; instruction_address[1] ; A9 ; 2 ; 26 ; 33 ; 0 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; Fitter ; 10 pF ;
; instruction_address[2] ; B9 ; 2 ; 26 ; 33 ; 1 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; Fitter ; 10 pF ;
; instruction_complete ; D8 ; 2 ; 24 ; 33 ; 1 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; Fitter ; 10 pF ;
; instruction_memory_select ; C8 ; 2 ; 24 ; 33 ; 0 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; Fitter ; 10 pF ;
; instruction_pointer_increment ; M8 ; 1 ; 0 ; 14 ; 1 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; Fitter ; 10 pF ;
; instruction_pointer_select ; M2 ; 1 ; 0 ; 13 ; 0 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; Fitter ; 10 pF ;
; mem_inst[0] ; H4 ; 1 ; 0 ; 23 ; 1 ; no ; no ; no ; no ; no ; no ; yes ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; Fitter ; 10 pF ;
; mem_inst[1] ; U9 ; 4 ; 26 ; 0 ; 1 ; no ; no ; no ; no ; no ; no ; yes ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; Fitter ; 10 pF ;
; mem_inst[2] ; T9 ; 4 ; 28 ; 0 ; 1 ; no ; no ; no ; no ; no ; no ; yes ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; Fitter ; 10 pF ;
; mem_inst[3] ; H5 ; 1 ; 0 ; 22 ; 2 ; no ; no ; no ; no ; no ; yes ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; Fitter ; 10 pF ;
; mem_inst[4] ; V8 ; 4 ; 22 ; 0 ; 1 ; no ; no ; no ; no ; no ; no ; yes ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; Fitter ; 10 pF ;
; mem_inst[5] ; H3 ; 1 ; 0 ; 23 ; 0 ; no ; no ; no ; no ; no ; no ; yes ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; Fitter ; 10 pF ;
; mem_inst[6] ; W8 ; 4 ; 24 ; 0 ; 1 ; no ; no ; no ; no ; no ; no ; yes ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; Fitter ; 10 pF ;
; mem_inst[7] ; J4 ; 1 ; 0 ; 21 ; 2 ; no ; no ; no ; no ; no ; no ; yes ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; Fitter ; 10 pF ;
; mem_inst[8] ; U4 ; 1 ; 0 ; 2 ; 0 ; no ; no ; no ; no ; no ; yes ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; Fitter ; 10 pF ;
; mul_a_select[0] ; F12 ; 2 ; 42 ; 33 ; 1 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; Fitter ; 10 pF ;
; mul_a_select[1] ; V12 ; 4 ; 42 ; 0 ; 0 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; Fitter ; 10 pF ;
; mul_b_select[0] ; A8 ; 2 ; 22 ; 33 ; 0 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; Fitter ; 10 pF ;
; mul_b_select[1] ; G7 ; 1 ; 0 ; 25 ; 0 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; Fitter ; 10 pF ;
; mul_complete ; D9 ; 2 ; 28 ; 33 ; 1 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; Fitter ; 10 pF ;
; mul_data[0] ; V11 ; 4 ; 34 ; 0 ; 0 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; Fitter ; 10 pF ;
; mul_data[1] ; D11 ; 2 ; 36 ; 33 ; 2 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; Fitter ; 10 pF ;
; mul_data[2] ; C11 ; 2 ; 34 ; 33 ; 0 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; Fitter ; 10 pF ;
; mul_data[3] ; D10 ; 2 ; 34 ; 33 ; 1 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; Fitter ; 10 pF ;
; mul_data[4] ; W11 ; 4 ; 36 ; 0 ; 1 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; Fitter ; 10 pF ;
; mul_data[5] ; A11 ; 2 ; 36 ; 33 ; 0 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; Fitter ; 10 pF ;
; mul_data[6] ; J8 ; 1 ; 0 ; 19 ; 0 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; Fitter ; 10 pF ;
; mul_data[7] ; A12 ; 2 ; 40 ; 33 ; 0 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; Fitter ; 10 pF ;
; mul_data[8] ; B12 ; 2 ; 40 ; 33 ; 1 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; Fitter ; 10 pF ;
; mul_p_input[0] ; U11 ; 4 ; 36 ; 0 ; 2 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; Fitter ; 10 pF ;
; mul_p_input[1] ; Y11 ; 4 ; 36 ; 0 ; 0 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; Fitter ; 10 pF ;
; mul_p_input[2] ; U8 ; 4 ; 22 ; 0 ; 0 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; Fitter ; 10 pF ;
; mul_p_input[3] ; W10 ; 4 ; 34 ; 0 ; 2 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; Fitter ; 10 pF ;
; mul_p_input[4] ; W12 ; 4 ; 38 ; 0 ; 0 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; Fitter ; 10 pF ;
; mul_p_input[5] ; C12 ; 2 ; 38 ; 33 ; 1 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; Fitter ; 10 pF ;
; mul_p_input[6] ; E12 ; 2 ; 42 ; 33 ; 0 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; Fitter ; 10 pF ;
; mul_p_input[7] ; M1 ; 1 ; 0 ; 13 ; 1 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; Fitter ; 10 pF ;
; mul_p_input[8] ; M5 ; 1 ; 0 ; 13 ; 2 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; Fitter ; 10 pF ;
; mul_start ; J13 ; 3 ; 69 ; 19 ; 1 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; Fitter ; 10 pF ;
; r0_enable ; L8 ; 1 ; 0 ; 14 ; 0 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; Fitter ; 10 pF ;
; r1_enable ; J3 ; 1 ; 0 ; 21 ; 1 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; Fitter ; 10 pF ;
; r1_select ; B10 ; 2 ; 32 ; 33 ; 2 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; Fitter ; 10 pF ;
; test_decode ; R9 ; 4 ; 28 ; 0 ; 0 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; Fitter ; 10 pF ;
+-------------------------------+-------+----------+--------------+--------------+-------------+-----------------+------------------------+---------------+----------------+-----------------+------------+---------------+----------+--------------+--------------+------------------+-------------+----------------------+-------+
+------------------------------------------------------------+
; I/O Bank Usage ;
+----------+------------------+---------------+--------------+
; I/O Bank ; Usage ; VCCIO Voltage ; VREF Voltage ;
+----------+------------------+---------------+--------------+
; 1 ; 25 / 80 ( 31 % ) ; 3.3V ; -- ;
; 2 ; 26 / 70 ( 37 % ) ; 3.3V ; -- ;
; 3 ; 12 / 81 ( 15 % ) ; 3.3V ; -- ;
; 4 ; 23 / 70 ( 33 % ) ; 3.3V ; -- ;
+----------+------------------+---------------+--------------+
+------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; All Package Pins ;
+----------+------------+----------+------------------------------------------+--------+--------------+---------+------------+-----------------+----------+--------------+
; Location ; Pad Number ; I/O Bank ; Pin Name/Usage ; Dir. ; I/O Standard ; Voltage ; I/O Type ; User Assignment ; Bus Hold ; Weak Pull Up ;
+----------+------------+----------+------------------------------------------+--------+--------------+---------+------------+-----------------+----------+--------------+
; A1 ; ; ; GND ; gnd ; ; ; -- ; ; -- ; -- ;
; A2 ; ; ; VCCINT ; power ; ; 1.5V ; -- ; ; -- ; -- ;
; A3 ; ; ; GND ; gnd ; ; ; -- ; ; -- ; -- ;
; A4 ; 310 ; 2 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; A5 ; ; 2 ; VCCIO2 ; power ; ; 3.3V ; -- ; ; -- ; -- ;
; A6 ; 302 ; 2 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; A7 ; 298 ; 2 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; A8 ; 292 ; 2 ; mul_b_select[0] ; output ; 3.3-V LVTTL ; ; Column I/O ; N ; no ; Off ;
; A9 ; 288 ; 2 ; instruction_address[1] ; output ; 3.3-V LVTTL ; ; Column I/O ; N ; no ; Off ;
; A10 ; 282 ; 2 ; alu_a[2] ; output ; 3.3-V LVTTL ; ; Column I/O ; N ; no ; Off ;
; A11 ; 275 ; 2 ; mul_data[5] ; output ; 3.3-V LVTTL ; ; Column I/O ; N ; no ; Off ;
; A12 ; 270 ; 2 ; mul_data[7] ; output ; 3.3-V LVTTL ; ; Column I/O ; N ; no ; Off ;
; A13 ; 264 ; 2 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; A14 ; 258 ; 2 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; A15 ; 255 ; 2 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; A16 ; ; 2 ; VCCIO2 ; power ; ; 3.3V ; -- ; ; -- ; -- ;
; A17 ; 247 ; 2 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; A18 ; ; ; GND ; gnd ; ; ; -- ; ; -- ; -- ;
; A19 ; ; ; VCCINT ; power ; ; 1.5V ; -- ; ; -- ; -- ;
; A20 ; ; ; GND ; gnd ; ; ; -- ; ; -- ; -- ;
; B1 ; ; ; VCCINT ; power ; ; 1.5V ; -- ; ; -- ; -- ;
; B2 ; ; ; GND ; gnd ; ; ; -- ; ; -- ; -- ;
; B3 ; 312 ; 2 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; B4 ; 311 ; 2 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; B5 ; 306 ; 2 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; B6 ; 303 ; 2 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; B7 ; 299 ; 2 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; B8 ; 293 ; 2 ; a_alu_load ; output ; 3.3-V LVTTL ; ; Column I/O ; N ; no ; Off ;
; B9 ; 289 ; 2 ; instruction_address[2] ; output ; 3.3-V LVTTL ; ; Column I/O ; N ; no ; Off ;
; B10 ; 283 ; 2 ; r1_select ; output ; 3.3-V LVTTL ; ; Column I/O ; N ; no ; Off ;
; B11 ; 276 ; 2 ; alu_r0[1] ; output ; 3.3-V LVTTL ; ; Column I/O ; N ; no ; Off ;
; B12 ; 271 ; 2 ; mul_data[8] ; output ; 3.3-V LVTTL ; ; Column I/O ; N ; no ; Off ;
; B13 ; 265 ; 2 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; B14 ; 259 ; 2 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; B15 ; 254 ; 2 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; B16 ; 249 ; 2 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; B17 ; 246 ; 2 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; B18 ; 245 ; 2 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; B19 ; ; ; GND ; gnd ; ; ; -- ; ; -- ; -- ;
; B20 ; ; ; VCCINT ; power ; ; 1.5V ; -- ; ; -- ; -- ;
; C1 ; ; ; GND ; gnd ; ; ; -- ; ; -- ; -- ;
; C2 ; 1 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; C3 ; 0 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; C4 ; 313 ; 2 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; C5 ; 307 ; 2 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; C6 ; 305 ; 2 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; C7 ; 296 ; 2 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; C8 ; 290 ; 2 ; instruction_memory_select ; output ; 3.3-V LVTTL ; ; Column I/O ; N ; no ; Off ;
; C9 ; 286 ; 2 ; address[1] ; output ; 3.3-V LVTTL ; ; Column I/O ; N ; no ; Off ;
; C10 ; 280 ; 2 ; alu_r0[0] ; output ; 3.3-V LVTTL ; ; Column I/O ; N ; no ; Off ;
; C11 ; 278 ; 2 ; mul_data[2] ; output ; 3.3-V LVTTL ; ; Column I/O ; N ; no ; Off ;
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; F10 ; 281 ; 2 ; alu_r1[3] ; output ; 3.3-V LVTTL ; ; Column I/O ; N ; no ; Off ;
; F11 ; ; 2 ; VCCIO2 ; power ; ; 3.3V ; -- ; ; -- ; -- ;
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; F13 ; ; 2 ; VCCIO2 ; power ; ; 3.3V ; -- ; ; -- ; -- ;
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; F20 ; 229 ; 3 ; instruction[0] ; input ; 3.3-V LVTTL ; ; Row I/O ; N ; no ; Off ;
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; G8 ; ; ; GND ; gnd ; ; ; -- ; ; -- ; -- ;
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; H6 ; 31 ; 1 ; a_enable ; output ; 3.3-V LVTTL ; ; Row I/O ; N ; no ; Off ;
; H7 ; 23 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
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; H9 ; ; ; GND ; gnd ; ; ; -- ; ; -- ; -- ;
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; H12 ; ; ; VCCINT ; power ; ; 1.5V ; -- ; ; -- ; -- ;
; H13 ; ; 3 ; VCCIO3 ; power ; ; 3.3V ; -- ; ; -- ; -- ;
; H14 ; 211 ; 3 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; H15 ; 223 ; 3 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
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; H17 ; 218 ; 3 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; H18 ; 219 ; 3 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; H19 ; 217 ; 3 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; H20 ; 216 ; 3 ; data[1] ; output ; 3.3-V LVTTL ; ; Row I/O ; N ; no ; Off ;
; J1 ; 28 ; 1 ; alu_a[1] ; output ; 3.3-V LVTTL ; ; Row I/O ; N ; no ; Off ;
; J2 ; 29 ; 1 ; data_mem_load ; output ; 3.3-V LVTTL ; ; Row I/O ; N ; no ; Off ;
; J3 ; 32 ; 1 ; r1_enable ; output ; 3.3-V LVTTL ; ; Row I/O ; N ; no ; Off ;
; J4 ; 33 ; 1 ; mem_inst[7] ; output ; 3.3-V LVTTL ; ; Row I/O ; N ; no ; Off ;
; J5 ; 34 ; 1 ; data_mem_enable ; output ; 3.3-V LVTTL ; ; Row I/O ; N ; no ; Off ;
; J6 ; 35 ; 1 ; alu_a[3] ; output ; 3.3-V LVTTL ; ; Row I/O ; N ; no ; Off ;
; J7 ; 36 ; 1 ; address[2] ; output ; 3.3-V LVTTL ; ; Row I/O ; N ; no ; Off ;
; J8 ; 37 ; 1 ; mul_data[6] ; output ; 3.3-V LVTTL ; ; Row I/O ; N ; no ; Off ;
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; J12 ; ; ; GND ; gnd ; ; ; -- ; ; -- ; -- ;
; J13 ; 205 ; 3 ; mul_start ; output ; 3.3-V LVTTL ; ; Row I/O ; N ; no ; Off ;
; J14 ; 210 ; 3 ; instruction[2] ; input ; 3.3-V LVTTL ; ; Row I/O ; N ; no ; Off ;
; J15 ; 214 ; 3 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; J16 ; 215 ; 3 ; data[3] ; output ; 3.3-V LVTTL ; ; Row I/O ; N ; no ; Off ;
; J17 ; 209 ; 3 ; address[0] ; output ; 3.3-V LVTTL ; ; Row I/O ; N ; no ; Off ;
; J18 ; 208 ; 3 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; J19 ; 213 ; 3 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; J20 ; 212 ; 3 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; K1 ; 40 ; 1 ; ^nCONFIG ; ; ; ; -- ; ; -- ; -- ;
; K2 ; 38 ; 1 ; ~nCSO~ / RESERVED_INPUT_WITH_WEAK_PULLUP ; input ; 3.3-V LVTTL ; ; Row I/O ; N ; no ; On ;
; K3 ; 39 ; 1 ; ^DATA0 ; input ; ; ; -- ; ; -- ; -- ;
; K4 ; ; ; VCCA_PLL1 ; power ; ; 1.5V ; -- ; ; -- ; -- ;
; K5 ; 41 ; 1 ; GND+ ; ; ; ; Row I/O ; ; -- ; -- ;
; K6 ; 42 ; 1 ; clock ; input ; 3.3-V LVTTL ; ; Row I/O ; N ; no ; Off ;
; K7 ; ; ; GNDA_PLL1 ; gnd ; ; ; -- ; ; -- ; -- ;
; K8 ; ; 1 ; VCCIO1 ; power ; ; 3.3V ; -- ; ; -- ; -- ;
; K9 ; ; ; GND ; gnd ; ; ; -- ; ; -- ; -- ;
; K10 ; ; ; VCCINT ; power ; ; 1.5V ; -- ; ; -- ; -- ;
; K11 ; ; ; GND ; gnd ; ; ; -- ; ; -- ; -- ;
; K12 ; ; ; VCCINT ; power ; ; 1.5V ; -- ; ; -- ; -- ;
; K13 ; ; 3 ; VCCIO3 ; power ; ; 3.3V ; -- ; ; -- ; -- ;
; K14 ; 201 ; 3 ; GND+ ; ; ; ; Row I/O ; ; -- ; -- ;
; K15 ; 207 ; 3 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; K16 ; 206 ; 3 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; K17 ; ; ; VCCA_PLL2 ; power ; ; 1.5V ; -- ; ; -- ; -- ;
; K18 ; 203 ; 3 ; #TDI ; input ; ; ; -- ; ; -- ; -- ;
; K19 ; 204 ; 3 ; a_load ; output ; 3.3-V LVTTL ; ; Row I/O ; N ; no ; Off ;
; K20 ; ; ; GNDA_PLL2 ; gnd ; ; ; -- ; ; -- ; -- ;
; L1 ; 45 ; 1 ; ^MSEL0 ; ; ; ; -- ; ; -- ; -- ;
; L2 ; 43 ; 1 ; ^nCEO ; ; ; ; -- ; ; -- ; -- ;
; L3 ; 47 ; 1 ; ^DCLK ; bidir ; ; ; -- ; ; -- ; -- ;
; L4 ; 48 ; 1 ; ~ASDO~ / RESERVED_INPUT_WITH_WEAK_PULLUP ; input ; 3.3-V LVTTL ; ; Row I/O ; N ; no ; On ;
; L5 ; 44 ; 1 ; ^nCE ; ; ; ; -- ; ; -- ; -- ;
; L6 ; 46 ; 1 ; ^MSEL1 ; ; ; ; -- ; ; -- ; -- ;
; L7 ; ; ; GNDG_PLL1 ; gnd ; ; ; -- ; ; -- ; -- ;
; L8 ; 49 ; 1 ; r0_enable ; output ; 3.3-V LVTTL ; ; Row I/O ; N ; no ; Off ;
; L9 ; ; ; VCCINT ; power ; ; 1.5V ; -- ; ; -- ; -- ;
; L10 ; ; ; GND ; gnd ; ; ; -- ; ; -- ; -- ;
; L11 ; ; ; VCCINT ; power ; ; 1.5V ; -- ; ; -- ; -- ;
; L12 ; ; ; GND ; gnd ; ; ; -- ; ; -- ; -- ;
; L13 ; 195 ; 3 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; L14 ; 202 ; 3 ; GND+ ; ; ; ; Row I/O ; ; -- ; -- ;
; L15 ; ; ; GNDG_PLL2 ; gnd ; ; ; -- ; ; -- ; -- ;
; L16 ; 199 ; 3 ; #TMS ; input ; ; ; -- ; ; -- ; -- ;
; L17 ; 197 ; 3 ; ^nSTATUS ; ; ; ; -- ; ; -- ; -- ;
; L18 ; 196 ; 3 ; ^CONF_DONE ; ; ; ; -- ; ; -- ; -- ;
; L19 ; 198 ; 3 ; #TCK ; input ; ; ; -- ; ; -- ; -- ;
; L20 ; 200 ; 3 ; #TDO ; output ; ; ; -- ; ; -- ; -- ;
; M1 ; 52 ; 1 ; mul_p_input[7] ; output ; 3.3-V LVTTL ; ; Row I/O ; N ; no ; Off ;
; M2 ; 51 ; 1 ; instruction_pointer_select ; output ; 3.3-V LVTTL ; ; Row I/O ; N ; no ; Off ;
; M3 ; 56 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; M4 ; 55 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; M5 ; 53 ; 1 ; mul_p_input[8] ; output ; 3.3-V LVTTL ; ; Row I/O ; N ; no ; Off ;
; M6 ; 54 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; M7 ; 57 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; M8 ; 50 ; 1 ; instruction_pointer_increment ; output ; 3.3-V LVTTL ; ; Row I/O ; N ; no ; Off ;
; M9 ; ; ; GND ; gnd ; ; ; -- ; ; -- ; -- ;
; M10 ; ; ; VCCINT ; power ; ; 1.5V ; -- ; ; -- ; -- ;
; M11 ; ; ; GND ; gnd ; ; ; -- ; ; -- ; -- ;
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; M13 ; 194 ; 3 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
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; M16 ; 190 ; 3 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; M17 ; 188 ; 3 ; data[0] ; output ; 3.3-V LVTTL ; ; Row I/O ; N ; no ; Off ;
; M18 ; 187 ; 3 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
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; M20 ; 191 ; 3 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; N1 ; 59 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
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; N5 ; 63 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; N6 ; 58 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; N7 ; 64 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
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; N11 ; ; ; VCCINT ; power ; ; 1.5V ; -- ; ; -- ; -- ;
; N12 ; ; ; GND ; gnd ; ; ; -- ; ; -- ; -- ;
; N13 ; ; 3 ; VCCIO3 ; power ; ; 3.3V ; -- ; ; -- ; -- ;
; N14 ; 180 ; 3 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
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; N20 ; 184 ; 3 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; P1 ; 67 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; P2 ; 66 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; P3 ; 70 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
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; P12 ; ; ; GND ; gnd ; ; ; -- ; ; -- ; -- ;
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; P14 ; 173 ; 3 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
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; R1 ; 72 ; 1 ; instruction[4] ; input ; 3.3-V LVTTL ; ; Row I/O ; N ; no ; Off ;
; R2 ; 73 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; R3 ; 76 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
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; R6 ; 74 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; R7 ; 103 ; 4 ; alu_r0[3] ; output ; 3.3-V LVTTL ; ; Column I/O ; N ; no ; Off ;
; R8 ; ; 4 ; VCCIO4 ; power ; ; 3.3V ; -- ; ; -- ; -- ;
; R9 ; 114 ; 4 ; test_decode ; output ; 3.3-V LVTTL ; ; Column I/O ; N ; no ; Off ;
; R10 ; ; 4 ; VCCIO4 ; power ; ; 3.3V ; -- ; ; -- ; -- ;
; R11 ; 126 ; 4 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; R12 ; ; 4 ; VCCIO4 ; power ; ; 3.3V ; -- ; ; -- ; -- ;
; R13 ; 134 ; 4 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; R14 ; 139 ; 4 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; R15 ; 172 ; 3 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; R16 ; 167 ; 3 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
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; R20 ; 169 ; 3 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; T1 ; ; 1 ; VCCIO1 ; power ; ; 3.3V ; -- ; ; -- ; -- ;
; T2 ; 79 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; T3 ; 80 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; T4 ; 78 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; T5 ; 91 ; 4 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; T6 ; 95 ; 4 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; T7 ; 96 ; 4 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; T8 ; 104 ; 4 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; T9 ; 113 ; 4 ; mem_inst[2] ; output ; 3.3-V LVTTL ; ; Column I/O ; N ; no ; Off ;
; T10 ; 117 ; 4 ; data_bus[1] ; output ; 3.3-V LVTTL ; ; Column I/O ; N ; no ; Off ;
; T11 ; 129 ; 4 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; T12 ; 130 ; 4 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; T13 ; 133 ; 4 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; T14 ; 140 ; 4 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; T15 ; 149 ; 4 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; T16 ; 150 ; 4 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; T17 ; 166 ; 3 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; T18 ; 164 ; 3 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; T19 ; 165 ; 3 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; T20 ; ; 3 ; VCCIO3 ; power ; ; 3.3V ; -- ; ; -- ; -- ;
; U1 ; 81 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; U2 ; 83 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; U3 ; 84 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; U4 ; 82 ; 1 ; mem_inst[8] ; output ; 3.3-V LVTTL ; ; Row I/O ; N ; no ; Off ;
; U5 ; 92 ; 4 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; U6 ; 99 ; 4 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; U7 ; 106 ; 4 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; U8 ; 108 ; 4 ; mul_p_input[2] ; output ; 3.3-V LVTTL ; ; Column I/O ; N ; no ; Off ;
; U9 ; 111 ; 4 ; mem_inst[1] ; output ; 3.3-V LVTTL ; ; Column I/O ; N ; no ; Off ;
; U10 ; 118 ; 4 ; alu_r1[0] ; output ; 3.3-V LVTTL ; ; Column I/O ; N ; no ; Off ;
; U11 ; 123 ; 4 ; mul_p_input[0] ; output ; 3.3-V LVTTL ; ; Column I/O ; N ; no ; Off ;
; U12 ; 131 ; 4 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; U13 ; 137 ; 4 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; U14 ; 143 ; 4 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; U15 ; 146 ; 4 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; U16 ; 154 ; 4 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; U17 ; 163 ; 3 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; U18 ; 161 ; 3 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; U19 ; 162 ; 3 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; U20 ; 160 ; 3 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; V1 ; ; ; GND ; gnd ; ; ; -- ; ; -- ; -- ;
; V2 ; 85 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; V3 ; 86 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; V4 ; 89 ; 4 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; V5 ; 93 ; 4 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; V6 ; 100 ; 4 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; V7 ; 105 ; 4 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; V8 ; 107 ; 4 ; mem_inst[4] ; output ; 3.3-V LVTTL ; ; Column I/O ; N ; no ; Off ;
; V9 ; 112 ; 4 ; instruction_address[0] ; output ; 3.3-V LVTTL ; ; Column I/O ; N ; no ; Off ;
; V10 ; 119 ; 4 ; data_bus[3] ; output ; 3.3-V LVTTL ; ; Column I/O ; N ; no ; Off ;
; V11 ; 122 ; 4 ; mul_data[0] ; output ; 3.3-V LVTTL ; ; Column I/O ; N ; no ; Off ;
; V12 ; 132 ; 4 ; mul_a_select[1] ; output ; 3.3-V LVTTL ; ; Column I/O ; N ; no ; Off ;
; V13 ; 138 ; 4 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; V14 ; 144 ; 4 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; V15 ; 145 ; 4 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; V16 ; 152 ; 4 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; V17 ; 153 ; 4 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; V18 ; 158 ; 3 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; V19 ; 159 ; 3 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; V20 ; ; ; GND ; gnd ; ; ; -- ; ; -- ; -- ;
; W1 ; ; ; VCCINT ; power ; ; 1.5V ; -- ; ; -- ; -- ;
; W2 ; ; ; GND ; gnd ; ; ; -- ; ; -- ; -- ;
; W3 ; 87 ; 4 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; W4 ; 90 ; 4 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; W5 ; 94 ; 4 ; instruction[7] ; input ; 3.3-V LVTTL ; ; Column I/O ; N ; no ; Off ;
; W6 ; 97 ; 4 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; W7 ; 101 ; 4 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; W8 ; 109 ; 4 ; mem_inst[6] ; output ; 3.3-V LVTTL ; ; Column I/O ; N ; no ; Off ;
; W9 ; 116 ; 4 ; data_bus[0] ; output ; 3.3-V LVTTL ; ; Column I/O ; N ; no ; Off ;
; W10 ; 120 ; 4 ; mul_p_input[3] ; output ; 3.3-V LVTTL ; ; Column I/O ; N ; no ; Off ;
; W11 ; 124 ; 4 ; mul_data[4] ; output ; 3.3-V LVTTL ; ; Column I/O ; N ; no ; Off ;
; W12 ; 128 ; 4 ; mul_p_input[4] ; output ; 3.3-V LVTTL ; ; Column I/O ; N ; no ; Off ;
; W13 ; 136 ; 4 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; W14 ; 141 ; 4 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; W15 ; 148 ; 4 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; W16 ; 151 ; 4 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; W17 ; 156 ; 4 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; W18 ; 157 ; 3 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; W19 ; ; ; GND ; gnd ; ; ; -- ; ; -- ; -- ;
; W20 ; ; ; VCCINT ; power ; ; 1.5V ; -- ; ; -- ; -- ;
; Y1 ; ; ; GND ; gnd ; ; ; -- ; ; -- ; -- ;
; Y2 ; ; ; VCCINT ; power ; ; 1.5V ; -- ; ; -- ; -- ;
; Y3 ; ; ; GND ; gnd ; ; ; -- ; ; -- ; -- ;
; Y4 ; 88 ; 4 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; Y5 ; ; 4 ; VCCIO4 ; power ; ; 3.3V ; -- ; ; -- ; -- ;
; Y6 ; 98 ; 4 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; Y7 ; 102 ; 4 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; Y8 ; 110 ; 4 ; alu_r1[1] ; output ; 3.3-V LVTTL ; ; Column I/O ; N ; no ; Off ;
; Y9 ; 115 ; 4 ; data_bus[2] ; output ; 3.3-V LVTTL ; ; Column I/O ; N ; no ; Off ;
; Y10 ; 121 ; 4 ; alu_r1[2] ; output ; 3.3-V LVTTL ; ; Column I/O ; N ; no ; Off ;
; Y11 ; 125 ; 4 ; mul_p_input[1] ; output ; 3.3-V LVTTL ; ; Column I/O ; N ; no ; Off ;
; Y12 ; 127 ; 4 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; Y13 ; 135 ; 4 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; Y14 ; 142 ; 4 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; Y15 ; 147 ; 4 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; Y16 ; ; 4 ; VCCIO4 ; power ; ; 3.3V ; -- ; ; -- ; -- ;
; Y17 ; 155 ; 4 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; Y18 ; ; ; GND ; gnd ; ; ; -- ; ; -- ; -- ;
; Y19 ; ; ; VCCINT ; power ; ; 1.5V ; -- ; ; -- ; -- ;
; Y20 ; ; ; GND ; gnd ; ; ; -- ; ; -- ; -- ;
+----------+------------+----------+------------------------------------------+--------+--------------+---------+------------+-----------------+----------+--------------+
Note: Pin directions (input, output or bidir) are based on device operating in user mode.
+------------------------------------------------------------------+
; Output Pin Default Load For Reported TCO ;
+---------------------+-------+------------------------------------+
; I/O Standard ; Load ; Termination Resistance ;
+---------------------+-------+------------------------------------+
; 3.3-V LVTTL ; 10 pF ; Not Available ;
; 3.3-V LVCMOS ; 10 pF ; Not Available ;
; 2.5 V ; 10 pF ; Not Available ;
; 1.8 V ; 10 pF ; Not Available ;
; 1.5 V ; 10 pF ; Not Available ;
; SSTL-3 Class I ; 30 pF ; 50 Ohm (Parallel), 25 Ohm (Serial) ;
; SSTL-3 Class II ; 30 pF ; 25 Ohm (Parallel), 25 Ohm (Serial) ;
; SSTL-2 Class I ; 30 pF ; 50 Ohm (Parallel), 25 Ohm (Serial) ;
; SSTL-2 Class II ; 30 pF ; 25 Ohm (Parallel), 25 Ohm (Serial) ;
; Differential SSTL-2 ; 10 pF ; (See SSTL-2) ;
; 3.3-V PCI ; 10 pF ; 25 Ohm (Parallel) ;
; LVDS ; 4 pF ; 100 Ohm (Differential) ;
; RSDS ; 10 pF ; 100 Ohm (Differential) ;
+---------------------+-------+------------------------------------+
Note: User assignments will override these defaults. The user specified values are listed in the Output Pins and Bidir Pins tables.
+---------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Fitter Resource Utilization by Entity ;
+-----------------------------------------+-------------+--------------+-------------+------+------+--------------+--------------+-------------------+------------------+-----------------+------------+-----------------------------------------------------------------------------------------------+--------------+
; Compilation Hierarchy Node ; Logic Cells ; LC Registers ; Memory Bits ; M4Ks ; Pins ; Virtual Pins ; LUT-Only LCs ; Register-Only LCs ; LUT/Register LCs ; Carry Chain LCs ; Packed LCs ; Full Hierarchy Name ; Library Name ;
+-----------------------------------------+-------------+--------------+-------------+------+------+--------------+--------------+-------------------+------------------+-----------------+------------+-----------------------------------------------------------------------------------------------+--------------+
; |top_level ; 161 (16) ; 42 ; 0 ; 0 ; 84 ; 0 ; 119 (16) ; 0 (0) ; 42 (0) ; 0 (0) ; 2 (0) ; |top_level ; work ;
; |4bit_register:A| ; 4 (4) ; 4 ; 0 ; 0 ; 0 ; 0 ; 0 (0) ; 0 (0) ; 4 (4) ; 0 (0) ; 0 (0) ; |top_level|4bit_register:A ; work ;
; |4bit_register:R0| ; 8 (8) ; 4 ; 0 ; 0 ; 0 ; 0 ; 4 (4) ; 0 (0) ; 4 (4) ; 0 (0) ; 0 (0) ; |top_level|4bit_register:R0 ; work ;
; |4bit_register:R1| ; 4 (4) ; 4 ; 0 ; 0 ; 0 ; 0 ; 0 (0) ; 0 (0) ; 4 (4) ; 0 (0) ; 0 (0) ; |top_level|4bit_register:R1 ; work ;
; |data_mem2:inst18| ; 9 (9) ; 4 ; 0 ; 0 ; 0 ; 0 ; 5 (5) ; 0 (0) ; 4 (4) ; 0 (0) ; 0 (0) ; |top_level|data_mem2:inst18 ; work ;
; |instruction_decode:inst1| ; 33 (12) ; 9 ; 0 ; 0 ; 0 ; 0 ; 24 (12) ; 0 (0) ; 9 (0) ; 0 (0) ; 1 (0) ; |top_level|instruction_decode:inst1 ; work ;
; |busmux:inst58| ; 3 (0) ; 0 ; 0 ; 0 ; 0 ; 0 ; 3 (0) ; 0 (0) ; 0 (0) ; 0 (0) ; 0 (0) ; |top_level|instruction_decode:inst1|busmux:inst58 ; work ;
; |lpm_mux:$00000| ; 3 (0) ; 0 ; 0 ; 0 ; 0 ; 0 ; 3 (0) ; 0 (0) ; 0 (0) ; 0 (0) ; 0 (0) ; |top_level|instruction_decode:inst1|busmux:inst58|lpm_mux:$00000 ; work ;
; |mux_5fc:auto_generated| ; 3 (3) ; 0 ; 0 ; 0 ; 0 ; 0 ; 3 (3) ; 0 (0) ; 0 (0) ; 0 (0) ; 0 (0) ; |top_level|instruction_decode:inst1|busmux:inst58|lpm_mux:$00000|mux_5fc:auto_generated ; work ;
; |ldr_decode:inst68| ; 5 (5) ; 3 ; 0 ; 0 ; 0 ; 0 ; 2 (2) ; 0 (0) ; 3 (3) ; 0 (0) ; 0 (0) ; |top_level|instruction_decode:inst1|ldr_decode:inst68 ; work ;
; |mul_decode:inst2| ; 7 (7) ; 3 ; 0 ; 0 ; 0 ; 0 ; 4 (4) ; 0 (0) ; 3 (3) ; 0 (0) ; 0 (0) ; |top_level|instruction_decode:inst1|mul_decode:inst2 ; work ;
; |str_decode:inst62| ; 6 (6) ; 3 ; 0 ; 0 ; 0 ; 0 ; 3 (3) ; 0 (0) ; 3 (3) ; 0 (0) ; 1 (1) ; |top_level|instruction_decode:inst1|str_decode:inst62 ; work ;
; |instruction_load:inst12| ; 6 (6) ; 2 ; 0 ; 0 ; 0 ; 0 ; 4 (4) ; 0 (0) ; 2 (2) ; 0 (0) ; 0 (0) ; |top_level|instruction_load:inst12 ; work ;
; |instruction_mem:inst6| ; 7 (7) ; 0 ; 0 ; 0 ; 0 ; 0 ; 7 (7) ; 0 (0) ; 0 (0) ; 0 (0) ; 0 (0) ; |top_level|instruction_mem:inst6 ; work ;
; |instruction_pointer:inst11| ; 3 (3) ; 3 ; 0 ; 0 ; 0 ; 0 ; 0 (0) ; 0 (0) ; 3 (3) ; 0 (0) ; 0 (0) ; |top_level|instruction_pointer:inst11 ; work ;
; |mul_mux:inst8| ; 9 (9) ; 0 ; 0 ; 0 ; 0 ; 0 ; 9 (9) ; 0 (0) ; 0 (0) ; 0 (0) ; 0 (0) ; |top_level|mul_mux:inst8 ; work ;
; |multiplier:inst| ; 62 (2) ; 12 ; 0 ; 0 ; 0 ; 0 ; 50 (1) ; 0 (0) ; 12 (1) ; 0 (0) ; 1 (0) ; |top_level|multiplier:inst ; work ;
; |add_subt_select:inst21| ; 1 (1) ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 (1) ; 0 (0) ; 0 (0) ; 0 (0) ; 0 (0) ; |top_level|multiplier:inst|add_subt_select:inst21 ; work ;
; |adder:inst17| ; 9 (0) ; 0 ; 0 ; 0 ; 0 ; 0 ; 9 (0) ; 0 (0) ; 0 (0) ; 0 (0) ; 0 (0) ; |top_level|multiplier:inst|adder:inst17 ; work ;
; |CLAadder:inst1| ; 1 (1) ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 (1) ; 0 (0) ; 0 (0) ; 0 (0) ; 0 (0) ; |top_level|multiplier:inst|adder:inst17|CLAadder:inst1 ; work ;
; |CLAadder:inst2| ; 1 (1) ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 (1) ; 0 (0) ; 0 (0) ; 0 (0) ; 0 (0) ; |top_level|multiplier:inst|adder:inst17|CLAadder:inst2 ; work ;
; |CLAadder:inst3| ; 1 (1) ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 (1) ; 0 (0) ; 0 (0) ; 0 (0) ; 0 (0) ; |top_level|multiplier:inst|adder:inst17|CLAadder:inst3 ; work ;
; |CLAadder:inst4| ; 1 (1) ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 (1) ; 0 (0) ; 0 (0) ; 0 (0) ; 0 (0) ; |top_level|multiplier:inst|adder:inst17|CLAadder:inst4 ; work ;
; |logic:inst| ; 5 (5) ; 0 ; 0 ; 0 ; 0 ; 0 ; 5 (5) ; 0 (0) ; 0 (0) ; 0 (0) ; 0 (0) ; |top_level|multiplier:inst|adder:inst17|logic:inst ; work ;
; |adder:inst18| ; 6 (0) ; 0 ; 0 ; 0 ; 0 ; 0 ; 6 (0) ; 0 (0) ; 0 (0) ; 0 (0) ; 0 (0) ; |top_level|multiplier:inst|adder:inst18 ; work ;
; |CLAadder:inst2| ; 1 (1) ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 (1) ; 0 (0) ; 0 (0) ; 0 (0) ; 0 (0) ; |top_level|multiplier:inst|adder:inst18|CLAadder:inst2 ; work ;
; |CLAadder:inst3| ; 2 (2) ; 0 ; 0 ; 0 ; 0 ; 0 ; 2 (2) ; 0 (0) ; 0 (0) ; 0 (0) ; 0 (0) ; |top_level|multiplier:inst|adder:inst18|CLAadder:inst3 ; work ;
; |CLAadder:inst4| ; 1 (1) ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 (1) ; 0 (0) ; 0 (0) ; 0 (0) ; 0 (0) ; |top_level|multiplier:inst|adder:inst18|CLAadder:inst4 ; work ;
; |logic:inst| ; 2 (2) ; 0 ; 0 ; 0 ; 0 ; 0 ; 2 (2) ; 0 (0) ; 0 (0) ; 0 (0) ; 0 (0) ; |top_level|multiplier:inst|adder:inst18|logic:inst ; work ;
; |adder:inst20| ; 2 (0) ; 0 ; 0 ; 0 ; 0 ; 0 ; 2 (0) ; 0 (0) ; 0 (0) ; 0 (0) ; 0 (0) ; |top_level|multiplier:inst|adder:inst20 ; work ;
; |CLAadder:inst3| ; 1 (1) ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 (1) ; 0 (0) ; 0 (0) ; 0 (0) ; 0 (0) ; |top_level|multiplier:inst|adder:inst20|CLAadder:inst3 ; work ;
; |CLAadder:inst4| ; 1 (1) ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 (1) ; 0 (0) ; 0 (0) ; 0 (0) ; 0 (0) ; |top_level|multiplier:inst|adder:inst20|CLAadder:inst4 ; work ;
; |bit_flips:inst| ; 9 (4) ; 0 ; 0 ; 0 ; 0 ; 0 ; 9 (4) ; 0 (0) ; 0 (0) ; 0 (0) ; 0 (0) ; |top_level|multiplier:inst|bit_flips:inst ; work ;
; |busmux:inst42| ; 5 (0) ; 0 ; 0 ; 0 ; 0 ; 0 ; 5 (0) ; 0 (0) ; 0 (0) ; 0 (0) ; 0 (0) ; |top_level|multiplier:inst|bit_flips:inst|busmux:inst42 ; work ;
; |lpm_mux:$00000| ; 5 (0) ; 0 ; 0 ; 0 ; 0 ; 0 ; 5 (0) ; 0 (0) ; 0 (0) ; 0 (0) ; 0 (0) ; |top_level|multiplier:inst|bit_flips:inst|busmux:inst42|lpm_mux:$00000 ; work ;
; |mux_6fc:auto_generated| ; 5 (5) ; 0 ; 0 ; 0 ; 0 ; 0 ; 5 (5) ; 0 (0) ; 0 (0) ; 0 (0) ; 0 (0) ; |top_level|multiplier:inst|bit_flips:inst|busmux:inst42|lpm_mux:$00000|mux_6fc:auto_generated ; work ;
; |input_select:inst9| ; 18 (18) ; 0 ; 0 ; 0 ; 0 ; 0 ; 18 (18) ; 0 (0) ; 0 (0) ; 0 (0) ; 1 (1) ; |top_level|multiplier:inst|input_select:inst9 ; work ;
; |np_register:inst16| ; 8 (8) ; 8 ; 0 ; 0 ; 0 ; 0 ; 0 (0) ; 0 (0) ; 8 (8) ; 0 (0) ; 0 (0) ; |top_level|multiplier:inst|np_register:inst16 ; work ;
; |state_machine:inst1| ; 7 (7) ; 3 ; 0 ; 0 ; 0 ; 0 ; 4 (4) ; 0 (0) ; 3 (3) ; 0 (0) ; 0 (0) ; |top_level|multiplier:inst|state_machine:inst1 ; work ;
+-----------------------------------------+-------------+--------------+-------------+------+------+--------------+--------------+-------------------+------------------+-----------------+------------+-----------------------------------------------------------------------------------------------+--------------+
Note: For table entries with two numbers listed, the numbers in parentheses indicate the number of resources of the given type used by the specific entity alone. The numbers listed outside of parentheses indicate the total resources of the given type used by the specific entity and all of its sub-entities in the hierarchy.
+--------------------------------------------------------------------------------------------------------+
; Delay Chain Summary ;
+-------------------------------+----------+---------------+---------------+-----------------------+-----+
; Name ; Pin Type ; Pad to Core 0 ; Pad to Core 1 ; Pad to Input Register ; TCO ;
+-------------------------------+----------+---------------+---------------+-----------------------+-----+
; data_bus[0] ; Output ; -- ; -- ; -- ; -- ;
; data_bus[1] ; Output ; -- ; -- ; -- ; -- ;
; data_bus[2] ; Output ; -- ; -- ; -- ; -- ;
; data_bus[3] ; Output ; -- ; -- ; -- ; -- ;
; mem_inst[0] ; Output ; -- ; -- ; -- ; -- ;
; mem_inst[1] ; Output ; -- ; -- ; -- ; -- ;
; mem_inst[2] ; Output ; -- ; -- ; -- ; -- ;
; mem_inst[3] ; Output ; -- ; -- ; -- ; -- ;
; mem_inst[4] ; Output ; -- ; -- ; -- ; -- ;
; mem_inst[5] ; Output ; -- ; -- ; -- ; -- ;
; mem_inst[6] ; Output ; -- ; -- ; -- ; -- ;
; mem_inst[7] ; Output ; -- ; -- ; -- ; -- ;
; mem_inst[8] ; Output ; -- ; -- ; -- ; -- ;
; a_enable ; Output ; -- ; -- ; -- ; -- ;
; instruction_complete ; Output ; -- ; -- ; -- ; -- ;
; mul_complete ; Output ; -- ; -- ; -- ; -- ;
; mul_start ; Output ; -- ; -- ; -- ; -- ;
; alu_a[0] ; Output ; -- ; -- ; -- ; -- ;
; alu_a[1] ; Output ; -- ; -- ; -- ; -- ;
; alu_a[2] ; Output ; -- ; -- ; -- ; -- ;
; alu_a[3] ; Output ; -- ; -- ; -- ; -- ;
; a_alu_load ; Output ; -- ; -- ; -- ; -- ;
; a_select ; Output ; -- ; -- ; -- ; -- ;
; mul_data[0] ; Output ; -- ; -- ; -- ; -- ;
; mul_data[1] ; Output ; -- ; -- ; -- ; -- ;
; mul_data[2] ; Output ; -- ; -- ; -- ; -- ;
; mul_data[3] ; Output ; -- ; -- ; -- ; -- ;
; mul_data[4] ; Output ; -- ; -- ; -- ; -- ;
; mul_data[5] ; Output ; -- ; -- ; -- ; -- ;
; mul_data[6] ; Output ; -- ; -- ; -- ; -- ;
; mul_data[7] ; Output ; -- ; -- ; -- ; -- ;
; mul_data[8] ; Output ; -- ; -- ; -- ; -- ;
; r1_enable ; Output ; -- ; -- ; -- ; -- ;
; r1_select ; Output ; -- ; -- ; -- ; -- ;
; r0_enable ; Output ; -- ; -- ; -- ; -- ;
; data_mem_enable ; Output ; -- ; -- ; -- ; -- ;
; data_mem_load ; Output ; -- ; -- ; -- ; -- ;
; address[0] ; Output ; -- ; -- ; -- ; -- ;
; address[1] ; Output ; -- ; -- ; -- ; -- ;
; address[2] ; Output ; -- ; -- ; -- ; -- ;
; alu_r0[0] ; Output ; -- ; -- ; -- ; -- ;
; alu_r0[1] ; Output ; -- ; -- ; -- ; -- ;
; alu_r0[2] ; Output ; -- ; -- ; -- ; -- ;
; alu_r0[3] ; Output ; -- ; -- ; -- ; -- ;
; alu_r1[0] ; Output ; -- ; -- ; -- ; -- ;
; alu_r1[1] ; Output ; -- ; -- ; -- ; -- ;
; alu_r1[2] ; Output ; -- ; -- ; -- ; -- ;
; alu_r1[3] ; Output ; -- ; -- ; -- ; -- ;
; mul_b_select[0] ; Output ; -- ; -- ; -- ; -- ;
; mul_b_select[1] ; Output ; -- ; -- ; -- ; -- ;
; mul_a_select[0] ; Output ; -- ; -- ; -- ; -- ;
; mul_a_select[1] ; Output ; -- ; -- ; -- ; -- ;
; instruction_pointer_increment ; Output ; -- ; -- ; -- ; -- ;
; a_load ; Output ; -- ; -- ; -- ; -- ;
; instruction_pointer_select ; Output ; -- ; -- ; -- ; -- ;
; instruction_memory_select ; Output ; -- ; -- ; -- ; -- ;
; test_decode ; Output ; -- ; -- ; -- ; -- ;
; data[0] ; Output ; -- ; -- ; -- ; -- ;
; data[1] ; Output ; -- ; -- ; -- ; -- ;
; data[2] ; Output ; -- ; -- ; -- ; -- ;
; data[3] ; Output ; -- ; -- ; -- ; -- ;
; instruction_address[0] ; Output ; -- ; -- ; -- ; -- ;
; instruction_address[1] ; Output ; -- ; -- ; -- ; -- ;
; instruction_address[2] ; Output ; -- ; -- ; -- ; -- ;
; mul_p_input[0] ; Output ; -- ; -- ; -- ; -- ;
; mul_p_input[1] ; Output ; -- ; -- ; -- ; -- ;
; mul_p_input[2] ; Output ; -- ; -- ; -- ; -- ;
; mul_p_input[3] ; Output ; -- ; -- ; -- ; -- ;
; mul_p_input[4] ; Output ; -- ; -- ; -- ; -- ;
; mul_p_input[5] ; Output ; -- ; -- ; -- ; -- ;
; mul_p_input[6] ; Output ; -- ; -- ; -- ; -- ;
; mul_p_input[7] ; Output ; -- ; -- ; -- ; -- ;
; mul_p_input[8] ; Output ; -- ; -- ; -- ; -- ;
; instruction[0] ; Input ; OFF ; OFF ; -- ; -- ;
; instruction[1] ; Input ; OFF ; OFF ; -- ; -- ;
; instruction[2] ; Input ; OFF ; OFF ; -- ; -- ;
; instruction[3] ; Input ; OFF ; OFF ; -- ; -- ;
; instruction[4] ; Input ; OFF ; OFF ; -- ; -- ;
; instruction[5] ; Input ; OFF ; OFF ; -- ; -- ;
; instruction[6] ; Input ; OFF ; OFF ; -- ; -- ;
; instruction[7] ; Input ; OFF ; OFF ; -- ; -- ;
; instruction[8] ; Input ; OFF ; OFF ; -- ; -- ;
; clock ; Input ; OFF ; OFF ; -- ; -- ;
; reg_select_overide ; Input ; ON ; ON ; -- ; -- ;
+-------------------------------+----------+---------------+---------------+-----------------------+-----+
+-------------------------------------------------------------+
; Pad To Core Delay Chain Fanout ;
+-------------------------------+-------------------+---------+
; Source Pin / Fanout ; Pad To Core Index ; Setting ;
+-------------------------------+-------------------+---------+
; instruction[0] ; ; ;
; instruction[1] ; ; ;
; instruction[2] ; ; ;
; instruction[3] ; ; ;
; instruction[4] ; ; ;
; instruction[5] ; ; ;
; instruction[6] ; ; ;
; instruction[7] ; ; ;
; instruction[8] ; ; ;
; clock ; ; ;
; reg_select_overide ; ; ;
; - reg_select_overide~114 ; 0 ; ON ;
+-------------------------------+-------------------+---------+
+------------------------------------------------------------------------------------------------------------------------------------------------+
; Control Signals ;
+---------------------------------------------------+---------------+---------+---------------+--------+----------------------+------------------+
; Name ; Location ; Fan-Out ; Usage ; Global ; Global Resource Used ; Global Line Name ;
+---------------------------------------------------+---------------+---------+---------------+--------+----------------------+------------------+
; clock ; PIN_K6 ; 11 ; Clock ; yes ; Global Clock ; GCLK3 ;
; data_mem2:inst18|inst38 ; LC_X33_Y20_N8 ; 4 ; Clock ; yes ; Global Clock ; GCLK5 ;
; inst17 ; LC_X28_Y20_N3 ; 5 ; Clock ; yes ; Global Clock ; GCLK1 ;
; inst3[3]~367 ; LC_X31_Y19_N4 ; 20 ; Output enable ; no ; -- ; -- ;
; instruction_decode:inst1|inst14 ; LC_X28_Y20_N6 ; 5 ; Clock ; yes ; Global Clock ; GCLK2 ;
; instruction_decode:inst1|inst18 ; LC_X28_Y20_N4 ; 5 ; Clock ; yes ; Global Clock ; GCLK0 ;
; instruction_decode:inst1|ldr_decode:inst68|inst25 ; LC_X30_Y20_N4 ; 2 ; Clock ; yes ; Global Clock ; GCLK6 ;
; instruction_decode:inst1|mul_decode:inst2|inst4 ; LC_X29_Y18_N5 ; 2 ; Clock ; no ; -- ; -- ;
; instruction_decode:inst1|mul_decode:inst2|inst47 ; LC_X28_Y18_N4 ; 2 ; Clock ; no ; -- ; -- ;
; instruction_decode:inst1|str_decode:inst62|inst47 ; LC_X28_Y19_N8 ; 2 ; Clock ; no ; -- ; -- ;
; instruction_load:inst12|inst ; LC_X28_Y19_N2 ; 4 ; Clock ; yes ; Global Clock ; GCLK4 ;
; instruction_load:inst12|inst4 ; LC_X29_Y19_N2 ; 2 ; Clock ; no ; -- ; -- ;
; instruction_mem:inst6|inst15[4]~162 ; LC_X29_Y20_N5 ; 12 ; Output enable ; no ; -- ; -- ;
; multiplier:inst|inst43 ; LC_X33_Y18_N0 ; 8 ; Clock ; yes ; Global Clock ; GCLK7 ;
; multiplier:inst|state_machine:inst1|inst3 ; LC_X29_Y18_N6 ; 3 ; Async. clear ; no ; -- ; -- ;
+---------------------------------------------------+---------------+---------+---------------+--------+----------------------+------------------+
+-----------------------------------------------------------------------------------------------------------------------+
; Global & Other Fast Signals ;
+---------------------------------------------------+---------------+---------+----------------------+------------------+
; Name ; Location ; Fan-Out ; Global Resource Used ; Global Line Name ;
+---------------------------------------------------+---------------+---------+----------------------+------------------+
; clock ; PIN_K6 ; 11 ; Global Clock ; GCLK3 ;
; data_mem2:inst18|inst38 ; LC_X33_Y20_N8 ; 4 ; Global Clock ; GCLK5 ;
; inst17 ; LC_X28_Y20_N3 ; 5 ; Global Clock ; GCLK1 ;
; instruction_decode:inst1|inst14 ; LC_X28_Y20_N6 ; 5 ; Global Clock ; GCLK2 ;
; instruction_decode:inst1|inst18 ; LC_X28_Y20_N4 ; 5 ; Global Clock ; GCLK0 ;
; instruction_decode:inst1|ldr_decode:inst68|inst25 ; LC_X30_Y20_N4 ; 2 ; Global Clock ; GCLK6 ;
; instruction_load:inst12|inst ; LC_X28_Y19_N2 ; 4 ; Global Clock ; GCLK4 ;
; multiplier:inst|inst43 ; LC_X33_Y18_N0 ; 8 ; Global Clock ; GCLK7 ;
+---------------------------------------------------+---------------+---------+----------------------+------------------+
+-----------------------------------------------------------------------------------------------------------------+
; Non-Global High Fan-Out Signals ;
+-------------------------------------------------------------------------------------------------------+---------+
; Name ; Fan-Out ;
+-------------------------------------------------------------------------------------------------------+---------+
; inst3[3]~367 ; 20 ;
; multiplier:inst|bit_flips:inst|inst48~377 ; 14 ;
; instruction_mem:inst6|inst23[7]~51 ; 14 ;
; instruction_pointer:inst11|inst ; 14 ;
; instruction_pointer:inst11|inst1 ; 14 ;
; multiplier:inst|np_register:inst16|inst ; 13 ;
; instruction_pointer:inst11|inst2 ; 13 ;
; multiplier:inst|np_register:inst16|inst8 ; 12 ;
; instruction_mem:inst6|inst15[4]~162 ; 12 ;
; multiplier:inst|state_machine:inst1|inst1 ; 11 ;
; instruction_mem:inst6|inst35[3]~55 ; 11 ;
; instruction_load:inst12|inst5~1 ; 11 ;
; multiplier:inst|np_register:inst16|inst7 ; 10 ;
; 4bit_register:R0|inst2 ; 10 ;
; instruction_mem:inst6|inst47[6]~102 ; 10 ;
; multiplier:inst|state_machine:inst1|inst2 ; 10 ;
; multiplier:inst|state_machine:inst1|inst5 ; 9 ;
; instruction_decode:inst1|str_decode:inst62|inst45 ; 9 ;
; multiplier:inst|state_machine:inst1|inst12 ; 8 ;
; instruction_load:inst12|inst45 ; 8 ;
; instruction_decode:inst1|str_decode:inst62|inst2 ; 7 ;
; multiplier:inst|bit_flips:inst|busmux:inst42|lpm_mux:$00000|mux_6fc:auto_generated|result_node[1]~142 ; 7 ;
; 4bit_register:R0|inst1 ; 7 ;
; 4bit_register:R0|inst3 ; 7 ;
; instruction_decode:inst1|mul_decode:inst2|inst45 ; 7 ;
; multiplier:inst|np_register:inst16|inst2 ; 6 ;
; multiplier:inst|np_register:inst16|inst3 ; 6 ;
; mul_mux:inst8|inst8[2]~547 ; 6 ;
; 4bit_register:R0|inst ; 6 ;
; instruction_decode:inst1|inst64 ; 6 ;
; instruction_decode:inst1|inst55~1 ; 6 ;
; multiplier:inst|state_machine:inst1|inst ; 6 ;
; instruction_decode:inst1|mul_decode:inst2|inst2 ; 6 ;
; instruction_decode:inst1|ldr_decode:inst68|inst ; 6 ;
; instruction_mem:inst6|inst15[4]~161 ; 6 ;
; instruction_load:inst12|inst2 ; 6 ;
; data_mem2:inst18|inst33~46 ; 5 ;
; inst3[0]~376 ; 5 ;
; inst3[1]~373 ; 5 ;
; inst3[2]~370 ; 5 ;
; inst3[3]~365 ; 5 ;
; reg_select_overide~114 ; 5 ;
; data_mem2:inst18|inst39~41 ; 5 ;
; multiplier:inst|state_machine:inst1|inst65~26 ; 5 ;
; mul_mux:inst8|inst8[3]~543 ; 5 ;
; instruction_decode:inst1|inst ; 5 ;
; instruction_decode:inst1|busmux:inst58|lpm_mux:$00000|mux_5fc:auto_generated|result_node[0]~20 ; 5 ;
; instruction_decode:inst1|busmux:inst58|lpm_mux:$00000|mux_5fc:auto_generated|result_node[1]~19 ; 5 ;
; instruction_decode:inst1|busmux:inst58|lpm_mux:$00000|mux_5fc:auto_generated|result_node[2]~18 ; 5 ;
; data_mem2:inst18|inst15 ; 4 ;
+-------------------------------------------------------------------------------------------------------+---------+
+-----------------------------------------------------+
; Interconnect Usage Summary ;
+----------------------------+------------------------+
; Interconnect Resource Type ; Usage ;
+----------------------------+------------------------+
; C4s ; 336 / 48,240 ( < 1 % ) ;
; Direct links ; 54 / 69,520 ( < 1 % ) ;
; Global clocks ; 8 / 8 ( 100 % ) ;
; LAB clocks ; 15 / 384 ( 4 % ) ;
; LUT chains ; 24 / 18,054 ( < 1 % ) ;
; Local interconnects ; 321 / 69,520 ( < 1 % ) ;
; M4K buffers ; 0 / 2,304 ( 0 % ) ;
; R4s ; 348 / 45,520 ( < 1 % ) ;
+----------------------------+------------------------+
+---------------------------------------------------------------------------+